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#1 Re: 全志 SOC » 自制全志H3核心板 » 2020-12-09 22:42:08

4层太勉强了,阻抗这块考虑了么?

#2 Re: Xilinx/Altera/FPGA/CPLD/Verilog » zynq7010/7020核心板众筹openzynq » 2020-10-31 17:40:45

有个问题想请教下作者,这两天在学习作者的原理图的时候,发现DDR3芯片上有两个电源引脚H9和B2没有连接,找了资料似乎没有发现必须断开连接的原因,想请教下作者,这两个VDD引脚为什么不连接电源呢?

#6 Re: RISC-V » 求一个可以通过openocd调试K210的cfg文件 » 2018-11-10 17:04:28

好的,谢谢!另外,用jlink的话,需要用软件更改为winusb驱动么?

#7 RISC-V » 求一个可以通过openocd调试K210的cfg文件 » 2018-11-10 13:13:42

knight_hu
回复: 7

想用泽畔老大的riscv的openocd调试器调试K210,无奈不会写cfg文件怎么也连不上,求一个能用的标准openocd调试器用的cfg文件,谢谢!

#8 Re: RISC-V » 荔枝派 $9 RISC-V开发板 (开放购买) » 2018-06-06 20:13:02

难道一个用来配置FPGA,一个作为spi flash使用,存放riscv的程序或者数据用?

#9 Re: 全志 SOC » 荔枝派zero使用brmin的最小文件系统移植tslib后执行ts_calibrate碰到invalid ELF header » 2018-06-06 20:05:15

今天重新做了buildroot和tslib,用的同一个工具链make的(linaro 6.3.1 2017.02 的arm-linux-gnueabihf-),可惜还是碰到同样的问题,invalid ELF header,make步骤参考的是
https://www.kancloud.cn/lichee/lpi0/418897
实在是晕了。。。。

#11 全志 SOC » 荔枝派zero使用brmin的最小文件系统移植tslib后执行ts_calibrate碰到invalid ELF header » 2018-06-06 08:51:21

knight_hu
回复: 3

这几天按照看云的说明吧uboot,kernel和brmin那个最小文件系统跑起来了,后移植了tslib,是按照tslib1.4移植全攻略那个文档做的,用tf卡拷贝安装到spiflash上以后,修改完profile,想执行ts校准程序,系统报错,
./ts_calibrate: error while loading shared libraries: /usr/local/tslib/tslib/lib/libts.so.0: invalid ELF header
请问有没有大神碰到过,是什么原因啊?
开发机是虚拟机下的ubuntu 16.04 64bit,工具链是linaro的6.3.1版本的gnueabihf,谢谢!

#12 Re: 全志 SOC » v3s按照看云构建spiflash系统,加入以太网功能碰到问题,求教 » 2018-05-29 09:06:41

顺便立马把配置指令加到/etc/init.d/rcS里面,每次启动就能自动配置了

#13 Re: 全志 SOC » v3s按照看云构建spiflash系统,加入以太网功能碰到问题,求教 » 2018-05-29 08:43:47

搞定了,果然要ifconfig eth0 up来手动打开才行,谢晕哥提醒

#14 全志 SOC » v3s按照看云构建spiflash系统,加入以太网功能碰到问题,求教 » 2018-05-28 22:21:02

knight_hu
回复: 5

按照看云上的文档,对于spiflash系统进行的构建,uboot阶段的以太网可以ping通,内核采用的是荔枝派zero的git下来的主线4.13.y的分支进行的构建,启动后貌似没有识别到以太网,构建钱按照看云文档已经修改了dts和配置了内核对以太网的支持,不知道哪里出了问题,还请大家一起看看,谢谢!
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